[實用新型] 用于對準(zhǔn)高數(shù)據(jù)速率時鐘和數(shù)據(jù)恢復(fù)解串器的采樣實例的系統(tǒng)
串行數(shù)據(jù)傳輸使用不斷增加的傳輸速率。通過使用并行處理串行輸入數(shù)據(jù)的多個獨立采樣器塊，可以增加時間和數(shù)據(jù)恢復(fù)(CDR)解串器的數(shù)據(jù)傳輸速率。為此目的，來自各個獨立塊的時鐘輸出信號首先使用較低速度的時鐘以適當(dāng)?shù)捻樞蛳嗷?zhǔn)，并且隨后彼此偏移，使得各種采樣器塊的采樣實例被交錯。在對準(zhǔn)時鐘輸出信號之后比較對應(yīng)于公共輸入數(shù)據(jù)并且由各種采樣器件輸出的數(shù)字化數(shù)據(jù)字，以校正多個采樣器塊之間的附加定時未對準(zhǔn)。在時鐘輸出信號對準(zhǔn)之后，數(shù)字化數(shù)據(jù)字僅需要一次或最多不對準(zhǔn)，因為附加的定時未對準(zhǔn)主要是由于隨時間基本上不變的路徑延遲引起的。

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